Fakultät für Informatik
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Technische Universität München
Lehrstuhl für Effiziente Algorithmen
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An interprocessor memory access arbitrating scheme for the S-3800 vector supercomputer
Tadayuki Sakakibara
,
Katsuyoshi Kitai
,
Tadaaki Isobe
,
Shigeko Yazawa
,
Teruo Tanaka
,
Yosiko Tamaki
,
Yasuhiro Inagami
Proceedings of the International Symposium on Parallel Architectures, Algorithms and Networks (ISPAN) (Kanazawa, Japan, December 14-16, 1994)
, 1994, pp. 262-269
Reducing network hardware quantity by employing multi-processor cluster structure in distributed memory parallel processors
Naoki Hamanaka
,
Junji Nakagoshi
,
Teruo Tanaka
Lecture Notes in Computer Science
634
, 1992, pp. 25-30