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Fakultät für Informatik - Technische Universität MünchenLehrstuhl für Effiziente Algorithmen |
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Theoretical Computer Science 402 (2-3), 2008, pp. 221-233
Editors | G. Ausiello, D. Sannella | |
Publisher: | Elsevier B.V. | |
Address: | Amsterdam-Boston-Jena-London-New York-Oxford-Paris-Philadelphia-San Diego-St. Louis | |
Keywords: | rational permutation, cache-oblivious algorithm, tall cache, lower bound, impossibility result, memory hierarchy | |
URL: |
http://www.sciencedirect.com/science/article/B6V1G-4SDGR75-1/2/4267608e02bff32d182840c60c2f2045 | |
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